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Translation - English: Writing Flash Memory in FR Family FR81S MCUs - KBA218673

質問：

FR81S MCUのflashメモリへの書込み方法は？

回答：

FRファミリFR81S MCUは、2つのシリアルライターでプログラムできます。CAN MCUは1つのシリアルライターでプログラムできます。

1. SIOを使用してFlashシリアルライターでプログラミング

2. UARTを使用してPCシリアルライターでプログラミング

注意：

l 各々のタイプのマイクロコントローラで指定できる水晶発振器の周波数は限定されます。

l PCのシリアルライターと互換性のあるマイクロコントローラの情報に関しては、サイプレステクニカルサポートにお問い合わせください。

3. CAN経由でのFlashシリアルライターでのプログラミング

シリアルライター（ヨコガワデジタルコンピュータ株式会社（YDC）製品など）を使用してCAN経由でFlash MCUにプログラミングする場合、ブートプログラム（YDCから）をFlash MCUにプログラムする必要があります。これはCANを使用しても可能です。

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Translation - English: Sequence to Disable I2C Module After Transmission for FCR4 MCUs - KBA211486

質問：

FCR4 MCUのI2C送信が完了した後にI2Cモジュールを無効にする正しい方法は何ですか？

回答：

送信後にI2Cモジュールを無効にする必要がある場合は、モジュールがアイドル状態になるまでの時間を与える必要があります。レジスタI2Cn_IBCSRには、BB（ビジービット）と呼ばれるビットフラグがあり、通信の進行中は「1」、通信が終了してモジュールがアイドル状態の場合は「0」になります。したがって、ユーザーはこのビジービットをチェックしてモジュールがアイドル状態であることを確認し、モジュールを無効にする必要があります。

1. プログラムの流れは次のとおりです。
2. I2Cスタートコンディションを生成します。
3. 読み取り/書き込みI2Cコマンドを発行します。
4. I2Cストップコンディションを生成します。
5. BBが0になるまで待ちます。
6. I2Cモジュールを無効にします。

I2Cモジュールを無効にすることは、通常のI2C動作には必要ありません。

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Translation - English: Failure to Compile Variadic Macro in FR Softune V6 - KBA218954

質問：

Variadic Macro：#define Macro(...)__VA_ARGS__をFR Softune V6でコンパイルできない理由は何ですか？

回答：

Variadicマクロは、C言語のC99標準（ISO / IEC 9899：1999）の新しいマクロです。FR Softune V6のコンパイラはANSIおよびC90（ISO / IEC 9899：1990）をサポートしていますが、C99はサポートしていません。したがって、FR Softune V6でコンパイルすると、以下に示す可変長マクロ定義が失敗します。

// 例えば。

#define MY_DEBUG_LOG(...)         (printf(__VA_ARGS__))

#define MY_DEBUG_TRACE(format,...)         (printf(format,##__VA_ARGS__))

サポートされているC/C ++言語規格の詳細については、FR Family Softune C/C _++ Compiler Manual for V6を参照してください。

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Translation - English: LVD of VCC53 in Traveo™ S6J3200 Series MCU - KBA221008

質問：VCC53にはLVD機能がありますか？

回答：いいえ。VCC53にLVD機能はありません。

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Translation - English: Simultaneously Using HyperBus™ and QSPI Bus in Traveo™ S6J3200 Series MCU – KBA221010

質問：　画像VRAM用のHyperRAM™と画像コンテンツデータ用のクアッドシリアルペリフェラルインターフェース（QSPI）の同時使用は可能ですか？

回答：　いいえ、使用できません。Hyper-BusとQSPI-Busは同じメモリアドレス領域にマッピングされています。

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Translation - English: Status of VCC53 Driving Pins during PSS Mode in Traveo™ S6J3200 Series – KBA221009

質問：　PSSモード時にVCC53駆動ピンはI/O信号を保持できますか？

回答：　はい。VCC53はPSSモード時にI/O信号を保持できます。

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Translation - English: Performance Differences of Traveo™ S6J3200 Series S6J327 and S6J328 MCUs – KBA221015

質問：　2Dグラフィックエンジン（3Dグラフィックエンジン以外）のみを使用する場合、S6J327のHyperBUS™性能はS6J328と同じですか？

回答：　はい、両方のMCUは同じ性能です。

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Translation - English: Variation of Parasitic Capacitance (CP) Between Segments in a Slider Design Using Dual IDAC Mode – KBA91404

質問：　

デュアルIDACモードを使用したスライダー設計で、あるセグメントから他のセグメントへの寄生容量はどれぐらい変動しますか？

回答：

スライダーは個別にスキャンされる多くのセグメントがあり、セントロイドアルゴリズムがすべてのセグメントの信号値に最終的に適応され、セントロイド位置が計算されます。CapSense^®アルゴリズムは、セグメントの中のCPの違いが原因で発生するセントロイドの非線形を回避するために、スライダーの特別な調整方法を実装しています。しかし、スライダーが機能するように下記のレイアウト条件を満たす必要があります。

1. セグメントのCPは、常に5-45pFのサポートレンジ内にして下さい。条件を満たすために、CY8CMBR3xxx CapSense設計ガイドで示されたレイアウトの最良事例に従っているか確認して下さい。
2. 他のセグメントのCPは、スライダーの最大値をセグメントのCPの75%以上にする必要があります。例えば、セグメントのCPが最大値30pFの場合、他のセグメントのCpは22.5pFよりも大きくする必要があります。デュアルIDACモードをサポートするPSoCデバイスファミリはCapSense MBR3、CY8C20xx7/S、およびPSoC 4になります。

この条件を満足するための下記レイアウト設計ルールの実装：

• すべてのセグメントの形が可能な限り同一となるように設計する
• CapSenseコントローラへのセグメントに接続されるトレースの長さと幅を、すべてのセグメントで同じにします
• センサーまたは、グランドあるいはハッチへのトレース間のエアギャップを同じに保ちます

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Translation - English: Data Retention Voltage of Backup RAM in Traveo™ S6J3200/S6J326C/324C/327C/328C/32DA/32BA/32G0 Series MCU - KBA222235

質問：

バックアップRAMのデータ保持電圧は何Vですか？

回答：

LVDL0はデータ保持電圧です。詳細はデータシートを確認して下さい。

S6J3200 シリーズ：

• データシート： http://www.cypress.com/file/254031/download
• ハードウェアマニュアル： http://www.cypress.com/file/254046/download

S6J326C/S6J324C/S6J327C/S6J328C/S6J32DA/S6J32BA シリーズ：

• データシート： http://www.cypress.com/file/254031/download
• ハードウェアマニュアル： http://www.cypress.com/file/254046/download

S6J32G0 シリーズ：

• データシート： http://www.cypress.com/file/307171/download
• ハードウェアマニュアル： http://www.cypress.com/file/332246/download

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タグ: traveo, s6j3, s6j3200, backup ram, s6j326c, s6j324c, s6j327c, s6j328c, s6j32da, s6j32ba, s6j32g0, data retention voltage