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PSoC 3 / PSoC 4 / PSoC 5LP / PSoC 6 MCUデザインでのフラッシュ行(row)の書き込み中のリセットについて- KBA229051 - Community Translated (JA)

PSoC 3 / PSoC 4 / PSoC 5LP / PSoC 6 MCUデザインでのフラッシュ行(row)の書き込み中のリセットについて- KBA229051 - Community Translated (JA)

ChaitanyaV_61
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Community Translated by  YoOb_1790021         Version: **

フラッシュ書き込み中は、デバイスの電源が安定している必要がありますので、デバイスをリセットしないでください。そうしないと、フラッシュ操作が中断され、完了したと安心はできません。フラッシュ行(row)の書き込み時間については、各デバイスのデータシートの Flash AC Specifications の表を参照してください

リセットソースには、XRESピン、ソフトウェアリセット、CPUロックアップ状態と特権違反、不適切な電源レベル、およびウォッチドッグリセットが含まれます。フラッシュ書き込み、Emulated EEPROMコンポーネント、ブートローダー、またはDevice Firmware Update SDKを設計にて使用している場合は、これらのリセットが誤ってアクティブにならないようにしてください。安定した電源設計に関する推奨事項については、各デバイスのハードウェア設計に関する考慮事項のアプリケーションノートを参照してください。

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